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程式碼 問題管理 82 合併請求 0 版本發佈 5 Wiki Activity
219 Commit
1 分支
64MB
目錄樹: ca4f317856
master
REL_2
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REL_1
PRE_1
DCHK_1
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1 次程式碼提交 (ca4f317856ab2f66c0d87be038d6cc3710695eeb)

作者 SHA1 備註 提交日期
  Michael Schloh von Bennewitz bb8473ae5a Complete production grade panelisation and foil design for LPKF frames. 4 年之前
  Michael Schloh von Bennewitz fe06fd495f Adjust track width, via drills, and annular rings to minimum specs. 4 年之前
  Michael Schloh von Bennewitz 8d28560c4e Tighten tolerances to highest four layer ENIG cheap fabrication capacity. 4 年之前
  Michael Schloh von Bennewitz f779b7999a Adapt layers and tolerances to correspond with four layer qualities. 4 年之前
  Michael Schloh von Bennewitz a71b05cc81 Prepare for layout edition in BGA with corresponding traces and vias. 4 年之前
  Michael Schloh von Bennewitz 41e5f095e8 Include more project boilerplate structure and library cache. 4 年之前
  Michael Schloh von Bennewitz 56dfb433cc Initialise hardware engineering for imminent schematic capture. 4 年之前
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